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Mostrando ítems 1-8 de 8
Smart e-ping: framework de interoperabilidade da arquitetura e-ping com a plataforma fiware para o uso em cidades inteligentes
(Pós-Graduação em Ciência da ComputaçãoUFS, 2019)
Fatores condicionantes da interoperabilidade: um estudo de caso em unidades da fundação Oswaldo Cruz
(Universidade Federal da Bahia, 2012)
O objetivo desta pesquisa foi identificar os fatores condicionantes de interoperabilidade de
Governo Eletrônico existentes em quatro Unidades da Fundação Oswaldo Cruz (Fiocruz) e de
que forma estes fatores podem influenciar ...
Fatores condicionantes da interoperabilidade: um estudo de caso em unidades da Fundação Oswaldo Cruz
(Universidade Federal da Bahia, 2012)
O objetivo desta pesquisa foi identificar os fatores condicionantes de interoperabilidade de Governo Eletrônico existentes em quatro Unidades da Fundação Oswaldo Cruz (Fio cruz) e de que forma estes fatores podem influenciar ...
Fatores condicionantes da interoperabilidade: um estudo de caso em unidades da Fundação Oswaldo Cruz
(Universidade Federal da Bahia, 2013)
Virtualização e execução de algoritmos em FPGA: um algoritmo de modulo scheduling para arranjos reconfiguráveis de grão grossoVirtualization and implementation of algorithms in FPGA: an modulo scheduling algorithm for coarse-grained reconfigurable archi- tecture
(Universidade Federal de ViçosaBRMetodologias e técnicas da Computação; Sistemas de ComputaçãoMestrado em Ciência da ComputaçãoUFV, 2015)
Mapeamento dinâmico de tarefas em MPSoCs heterogêneos baseados em NoC
(Pontifícia Universidade Católica do Rio Grande do SulPorto Alegre, 2009)
MPSoCs are multi-processor systems integrated in a single chip. They are a trend in VLSI circuit design, since they minimize the design productivity crisis represented by the gap between the silicon technol-ogy and the ...
Mapeamento dinâmico de tarefas em MPSoCs heterogêneos baseados em NoC
(Pontifícia Universidade Católica do Rio Grande do SulPorto Alegre, 2009)
MPSoCs are multi-processor systems integrated in a single chip. They are a trend in VLSI circuit design, since they minimize the design productivity crisis represented by the gap between the silicon technol-ogy and the ...